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江波龙 DDR5预览，DDR5内存为什么这么强？
从2020年7月，JEDEC固态技术协会正式公布DDR5内存行业标准开始，DDR5内存便已经算悄然纸面发布。JEDEC固态技术协会表示，DDR5内存传输带宽将是DDR4的2倍，并将以DDR5-4800MHz的频率起跳，比DDR4 JEDEC官方标准最高频 ...
一条内存两个通道+突发长度翻倍到BL16
我们知道处理器的内存控制器位宽为64-Bit。从第一代DDR内存开始，内存位宽就被设计为64-Bit位宽，但到了DDR4内存，半导体的电容充放速度以及IO速率达到了一个瓶颈。此时，JEDEC组织引入了一个新特性叫Bank Group，通过不同颗粒上的Banks组合进行同时读写，能“拼凑”出DDR 3 2倍的数据量，以提升DDR4内存的读写性能。但这也创造了新的问题，两个Bank Group的队列读写中间会有等待时间，这个等待时间就叫tCCD，也是DDR4内存的新延迟时间之一。
为什么我们要把突发长度和突发长度的改进放在这里说呢？因为这两者是息息相关的存在。突发长度英语叫Burst Length。通俗点可以理解为突发长度是处理器向内存某个地址发起读或写请求时，内存将该列地址解析并将相关地址里的数据连续提供给处理器或将数据分配到对应地址中，这个次数就是突发长度。用更通俗的话来说就是，IO端口是一辆高铁，乘客是数据，乘客拿着车票找乘务员找位置，乘务员神奇的通过“大数据”不但帮这位乘客找到了位置，还把他附近位置的16位乘客都安排好了。 DDR4，突发长度为BL8；DDR5，突发长度为BL16。后面的数字代表了能连续读写的封包数据量，DDR5可以突发连续读写16次。 说完突发长度，我们再说回DDR5内存新特性的双侧通道模式。DDR5双侧通道32-bit+32-bit，突发长度16，所以32bit（比特） x 16=512bit=64byte（字节），这里需要注意其数据单位。处理器的缓存封包单位限制为64byte/Op，内存与处理器交换的数据大小必须与其对等。 通过这个计算，我们就能得出DDR4一次操作可以交付64 bit x BL8=64byte（字节），DDR5一次操作可以交付（32bit x BL16=64byte）+（32bit x BL16=64byte），这使其有效带宽增加了1倍。 突发长度还与预取模式有关，这两个概念经常会被混淆，但实际上并不是一个东西。经常被混淆的原因是，这两个的概念非常相似，且一般相等，所以会被混淆。没错，DDR5的预取模式也从8n提升到了16n，预取模式就是内存cell往外吐数据，将他们排成一列等安排的操作。如果通俗的解释这两者的关系，咱们书接上一回，乘务员可以连续16次安排乘客的位置，但首先需要有16位乘客的存在才能安排，预取的作用就是事先安排好16位乘客。 |
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- 引用 pyb1986123
- 组装也叫国产，可以啊
- 引用 橙黄鼠标
pphiuyt 发表于 2021-4-9 23:24
起步16G? 有点过了吧 ssd速度提升的情况下对内存依赖小了些 普通用户8G*2 就够了 超频大容量的也费劲 ...
以未来五年来说，16G不夸张。
- 引用 pphiuyt
- 本帖最后由 pphiuyt 于 2021-4-11 01:54 编辑
橙黄鼠标 发表于 2021-4-10 20:44
以未来五年来说，16G不夸张。
问题是 16G的双通道32G 从2013年就用8GX2 DDR3 玩游戏到现在一个也没占用到警戒值 两根16G的双通道32G只能专业工具用得到了 自从安卓app爆发exe的进程就放慢脚步了
未来五年估计8GX2也是主流 单条1R16G DDR5组个双通道还是奢侈 除非价格继续白菜 如果桌面pc来个三通道四通道单条8G还是优势
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